projekte:usbblaster:start
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projekte:usbblaster:start [2015/02/14 17:26] – [LOGIC] yc | projekte:usbblaster:start [2017/08/30 13:35] (aktuell) – [EEPROM-Programmierung] yc | ||
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===== Vorgeschichte ===== | ===== Vorgeschichte ===== | ||
- | Damals, vor vielen Jahren, hat sich Sebastian DL3YC mit dem Selbstbau von Logic Analyzern beschäftigt. Das war die Zeit als Nachbau-Versuche vom Salea Logic begannen erfolgreich zu werden. Dadurch bestärkt und auch durch die berufliche Auseinandersetzung mit dem USB-Schaltkreis FX2 von Cypress, entstand der Wunsch nach einem FX2-basierten Logic Analyzer, der die hervorragende Software von Salea nutzen kann. Der Trick ist dabei, dass die Firmware zur Laufzeit auf das Gerät geladen wird und man nur dafür sorgen musste, dass der Schaltkreis sich mit der richtigen Produkt- und Hersteller-ID per USB meldet. Dazu schreibt man sie in einen I²C-EEPROM, | + | < |
- | Dies war alles im Jahre 2010, es entstanden selbst gebaute Leiterplatten von Sebastian und auch Winni DL2AWT(Datecode auf dem PCB: 5010, also KW50 2010). Vorallem die Leiterplatte von Winni hatte Potenzial, da man mit dieser auch einen schnellen AD-Wandler angebunden hat. Alle Leiterplatten hatten leider gemein, dass sie Probleme beim Enumerieren als Hi-Speed-Gerät haben. Dieses Problem zeigte sich auf sehr unterschiedliche und schlecht reproduzietrbare Weise. " | + | Dies war alles im Jahre 2010, es entstanden selbst gebaute Leiterplatten von Sebastian und auch Winni DL2AWT(Datecode auf dem PCB: 5010, also KW50 2010). Vorallem die Leiterplatte von Winni hatte Potenzial, da man mit dieser auch einen schnellen AD-Wandler angebunden hat. Alle Leiterplatten hatten leider gemein, dass sie Probleme beim Enumerieren als Hi-Speed-Gerät haben. Dieses Problem zeigte sich auf sehr unterschiedliche und schlecht reproduzietrbare Weise. " |
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- | Jetzt liegen also noch die Leiterplatten und vorallem auch die teuren USB-Schaltkreise rum. Um den leider fehlgeschlagenen Projekt noch einen Sinn zu geben, werden auf Grundlage dieser Leiterplatten USB-Blaster hergestellt. Dazu wird die Leiterplatte für eine übliche JTAG-Verbindung umgebaut. Als Software läuft auf der Zypresse eine freie Firmware, | + | Jetzt liegen also noch die Leiterplatten und vorallem auch die teuren USB-Schaltkreise rum. Um den leider fehlgeschlagenen Projekt noch einen Sinn zu geben, werden auf Grundlage dieser Leiterplatten USB-Blaster hergestellt. Dazu wird die Leiterplatte für eine übliche JTAG-Verbindung umgebaut. Als Software läuft auf der Zypresse eine freie Firmware, |
===== LOGIC ===== | ===== LOGIC ===== | ||
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{{: | {{: | ||
===== Umbau der Leiterplatte ===== | ===== Umbau der Leiterplatte ===== | ||
- | ===== Software-Anpassung ===== | + | Es wird die Leiterplatte größtenteils laut Schaltplan von LOGIC aufgebaut. Es wird die Minimalbeschaltung beschrieben und die zu bestückenden BE in der empfohlenen Aufbaureihenfolge aufgelistet: |
- | ===== Inbetriebnahme ===== | + | |
+ | * R19 mit 1M bestücken | ||
+ | * H1 mit grüner LED bestücken | ||
+ | * Spannung über C12 soll 3,3V betragen, grüne LED leuchtet | ||
+ | - U2, U3, C1-C11, Q1, C17, C18, R8, R1, R2, R4, R6 | ||
+ | * R4 und R5 mit 4k7 bestücken | ||
+ | * R8 mit 1M bestücken | ||
+ | * C18 mit 12p bestücken | ||
+ | * Nach Anstecken von USB wird ein neues Gerät mit VID = 0x04B4 und PID = 0x8613 erkannt | ||
+ | - D5, D7, D4, D8 | ||
+ | - JTAG-Stecker bestücken | ||
+ | - mit dünnen Lackdraht die Verbindungen zwischen Steckverbinder und Zypresse herstellen | ||
+ | | PC2 - 59 | TCK | 1 | 2| GND | | ||
+ | | PC1 - 58 | TDO | 3 | 4| V_FPGA | | ||
+ | | PC3 - 60 | TMS | 5 | 6| NC | | ||
+ | | | NC | 7 | 8 | NC | | ||
+ | | PC0 - 57 | TDI | 9 | 10| GND | | ||
+ | ===== EEPROM-Programmierung ===== | ||
+ | Zuerst lädt man sich // | ||
+ | |||
+ | Danach wird das Gerät angeschlossen und die Bus- und Gerätenummer ermittelt: | ||
+ | < | ||
+ | # lsusb | ||
+ | Bus 004 Device 006: ID 04b4:8613 Cypress Semiconductor Corp. CY7C68013 EZ-USB FX2 USB 2.0 Development Kit | ||
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+ | In diesem Beispiel ist die Gerätenummer 006 und der Bus 004.\\ | ||
+ | Mit diesen Angaben wird die kompilierte Firmware im Hex-Format auf das Gerät bespielt. Direkt danach enumeriert sich das Gerät neu, diesmal als USBBlaster. | ||
+ | < | ||
+ | # fxload -I usbjtag.hex -D / | ||
+ | # dmesg | ||
+ | [75309.252135] usb 1-5: new high-speed USB device number 13 using ehci-pci | ||
+ | [75309.384450] usb 1-5: config 1 interface 0 altsetting 0 bulk endpoint 0x81 has invalid maxpacket 64 | ||
+ | [75309.384463] usb 1-5: config 1 interface 0 altsetting 0 bulk endpoint 0x2 has invalid maxpacket 64 | ||
+ | [75309.384937] usb 1-5: New USB device found, idVendor=09fb, | ||
+ | [75309.384944] usb 1-5: New USB device strings: Mfr=1, Product=2, SerialNumber=3 | ||
+ | [75309.384951] usb 1-5: Product: USB-Blaster | ||
+ | [75309.384957] usb 1-5: Manufacturer: | ||
+ | [75309.384963] usb 1-5: SerialNumber: | ||
+ | </ | ||
+ | Nun ist das Gerät bereit als USBBlaster zu fungieren\\ | ||
+ | **Zu beachten:** Dieser Prozess muss bei jedem erneuten Einstecken des USBBlasters gemacht werden. Um die Firmware dauerhaft in das EEPROM zu schreiben, fehlt noch ein 2nd Stage Bootloader. | ||
+ | |||
+ | Für Benutzer von Arch Linux ist ein AUR [[https:// | ||
+ | < | ||
+ | # fxload-libusb -i usbjtag.hex -t fx2lp | ||
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projekte/usbblaster/start.txt · Zuletzt geändert: 2017/08/30 13:35 von yc